1樓：網友
這個很簡單。
這個是xilinx公司的產品，**程式有兩種，一種是bit檔案那是**到fpga中的，一種一般是mcs檔案，一般**到eeprom中。
eeprom是在fpga外部，當然在板子上。
2樓：網友
可以看下這個**，spartan-3e的中文翻譯。
3樓：網友
是fpga外部的配置晶元。這種晶元都是和fpga有對應關係的，當然是相應fpga廠家生產的。就像altera的epcs系列。
這些基於查詢表的fpga容量可以做的很大，適合設計複雜程式，掉電程式丟失，在上電時由片外rom將程式匯入fpga中。一般這個過程不超過幾十毫秒。
4樓：網友
fpga是沒有片內ram的，程式一般是存在片外的prom中的，上電時程式自動載入到fpga上，掉電後fpga不儲存程式。
5樓：網友
fpga當然是基於ram的方式，但是為了保證掉電後能重新配置，在外部有乙個prom，上電後自動為fpga配置。
6樓：網友
有不同的配置方式，上電後自動載入的是在eprom
載入在ram中掉電後會丟失。
我做的fpga課題要用到大量的資料，我用的xilinx的板子，大概會用到100塊ram,但每塊ram深度不深。
7樓：網友
我最近剛好在給vivado做ram的一些**。ram當然有數量限制。你可以看你的晶元的具體引數。
不知你用的是哪個系列的晶元，中端的晶元 100塊的話應該問題不大。而且如果ram不夠用了，程式會呼叫lut資源來做ram ( select/lut ram). 如果你的每個ram size都不大的話，會直接用lut做ram，而不呼叫專門的ram。
8樓：網友
有啊 使用ram不要超過80% 容易報錯。
xilinx系列fpga ram配置的問題 求大神
9樓：網友
xilinx的block ram每塊是16k bit，可以配置成16k x1,8k x2,4kx4,。。一直到512x36。你要實現的是124000x5 bit，當然不管內建的還是回外答置的ram，都沒有5 bit的寬度，一般還是要到8位的。
但用blockram有乙個好處，你可以用5個124000x1的ram來實現，其中乙個124000x1需要由大概8塊block ram來實現，那麼124000x5就需要8 * 5=40個block ram來實現。4vsx25一共有128個block ram，理論上資源是夠的。
block ram當然是可以呼叫ip核的，xilinx提供乙個logicore的工具，可以自由搭建你需要的寬度和深度的ram。
xilinx spartan-6系列fpga讀取與ddr3出錯，求大神指點.....
10樓：網友
感覺像是硬體上的問題，既然你的板在電壓下正常，為啥不查你的fpga bank是否有直接連線到電源電壓的bank呢？如果有，那bank 的i/o電壓由改成了，資料當然就不對了。
xilinx fpga上電配置過程是否自動完成的？
11樓：網友
xilinx的 fpga有六種配置模式。
需要專門的電路來支援的。
如果使用了外部的eeprom或者flash電路或者使用了spartan3an系列的fpga，在第一次把燒結檔案燒寫入eeprom或者flash裡面之後，第二次之後的上電配置過程我想是可以認為是自動完成的。
具體模式和做法需要參考具體的晶元datasheet
在fpga開發過程中,程式設計與配置這兩個操作有什麼區別?
12樓：網友
在fpga開發中，應當用「描述」語言而不是「程式設計」語言來描述你的硬體設計；
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